基于Xilinx FPGA的硬件协处理器设计

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DSP+FPGA模式具有结构复杂、成本高以及资源浪费比较严重的缺点,基于FPGA的软硬件协同设计已成为DSP+FPGA的理想替代方案。FPGA软硬件协同系统中,硬件协处理器的高效设计尤其重要。Xilinx提供了三种硬件协处理器设计方法:HDL语言+IP核,System Generator和HLS(High-Level Synthesis)。鉴于HDL语言描述算法能力有限,重点研究了后两种硬件设计方式。在实验环节选取Sobel边缘提取算法,并用System Generator和HLS加以实现。最终结果说明,
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