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信号完整性是高速电路设计的重要环节，讨论了信号反射、信号过冲和下冲、接地跳动、串扰、定时抖动与信号迟延等影响高速电路信号完整性的主要因素，提出了在时域和频域测量信号完整性测试主要指标；给出了基于建模仿真解决信号完整性问题和基于电路合理布局和优化设计解决信号完整性问题的方法建议。
高速电路的信号完整性研究
【摘 要】
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信号完整性是高速电路设计的重要环节，讨论了信号反射、信号过冲和下冲、接地跳动、串扰、定时抖动与信号迟延等影响高速电路信号完整性的主要因素，提出了在时域和频域测量信号
【机 构】
：
空军工程大学
【出 处】
：
电子工艺技术
【发表日期】
：
2007年5期
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