【摘 要】
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介绍了一种基于NIOS Ⅱ实现数字信号解码器的方法,该系统由FPGA和相应接口电路组成,将NIOS Ⅱ嵌入式软核CPU集成到FPGA中构成片上系统(SOC),可以将串行输入的不归零PCM码转换
【机 构】
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中北大学仪器科学与动态测试教育部重点实验室,
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介绍了一种基于NIOS Ⅱ实现数字信号解码器的方法,该系统由FPGA和相应接口电路组成,将NIOS Ⅱ嵌入式软核CPU集成到FPGA中构成片上系统(SOC),可以将串行输入的不归零PCM码转换为可分析的8位并行码,并通过上位机软件显示解码结果。
A method of implementing digital signal decoder based on NIOS Ⅱ is introduced. The system consists of FPGA and corresponding interface circuit, and integrates NIOS Ⅱ embedded soft CPU into FPGA to form system on chip (SOC) Non-return to zero PCM code can be converted to 8-bit parallel code analysis, and through the host computer software decoding results.
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