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提出了一种基于SystemC的伪随机序列发生器硬件设计，并使用Agility Compiler软件完成了仿真。仿真结果表明，该设计方法效率高，且灵活性强。
基于SystemC语言的伪随机序列发生器设计
【摘 要】
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提出了一种基于SystemC的伪随机序列发生器硬件设计，并使用Agility Compiler软件完成了仿真。仿真结果表明，该设计方法效率高，且灵活性强。
【机 构】
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中国船舶重工集团公司第722研究所
【出 处】
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舰船电子工程
【发表日期】
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2010年2期
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