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设计了一种准规则Q矩阵LDPC码编码器。该编码器基于准规则Q矩阵LDPC码的校验矩阵，其编码复杂度与信息位的长度成正比，有效降低了编码复杂度和设计难度。在Quartus II平台上用FPGA实现了该编码器，结果证明其硬件资源占用很少。
准规则Q矩阵LDPC码编码器设计
【摘 要】
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设计了一种准规则Q矩阵LDPC码编码器。该编码器基于准规则Q矩阵LDPC码的校验矩阵，其编码复杂度与信息位的长度成正比，有效降低了编码复杂度和设计难度。在Quartus II平台上用FP
【机 构】
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西安电子科技大学综合业务网理论及关键技术国家重点实验室
【出 处】
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电视技术
【发表日期】
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2007年11期
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