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期刊论文
AES算法的快速硬件设计与实现
AES算法的快速硬件设计与实现
来源 :电子技术应用 | 被引量 : 0次 | 上传用户:pie1011
【摘 要】
:
基于FPGA并采用流水线技术和优化设计,提出了一种更高效的AES算法IP核的硬件设计方法.在使用较低时钟频率的情况下,可以获得更大的数据吞吐量和更快的传输速度.
【作 者】
:
李雪梅
路而红
欧海文
【机 构】
:
北京电子科技学院
【出 处】
:
电子技术应用
【发表日期】
:
2006年5期
【关键词】
:
AES
FPGA
流水线
吞吐量
【基金项目】
:
国家自然基金资助项目,编号:60173016,学院信息安全重点实验室基金项目.
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基于FPGA并采用流水线技术和优化设计,提出了一种更高效的AES算法IP核的硬件设计方法.在使用较低时钟频率的情况下,可以获得更大的数据吞吐量和更快的传输速度.
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