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在嵌入式开发调试中,逻辑分析仪可以很好的辅助开发人员进行断点、触发和跟踪等调试.本设计应用Verilog HDL硬件描述语言和FPGA芯片设计一个多通道的简易逻辑分析仪,当逻辑信号的门限电压以0.25V为步长值在0.25V~4V之间变化时,具有16级采样速率,即可实现一个16通道的逻辑分析仪.
基于FPGA的简易逻辑分析仪设计
【摘 要】
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在嵌入式开发调试中,逻辑分析仪可以很好的辅助开发人员进行断点、触发和跟踪等调试.本设计应用Verilog HDL硬件描述语言和FPGA芯片设计一个多通道的简易逻辑分析仪,当逻辑信
【机 构】
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玉林师范学院电子与通信工程学院; 玉林师范学电子与通信工程学院;
【出 处】
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玉林师范学院学报
【发表日期】
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2013年05期
【基金项目】
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玉林师范学院青年(资助经费)科研项目(2012YJQN01)
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