【摘 要】
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面向高速串行接口应用,设计了一款25 Gibit/s的大摆幅电压模逻辑发送器.输出驱动器由3个相同的子驱动器并联而成,且每个子驱动器都包含依据二进制权重递增的5个驱动单元,从而
【机 构】
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厦门理工学院光电与通信工程学院,福建厦门361024;中国科学院半导体研究所,北京100083;北京理工大学信息与电子学院,北京100081;佛山科学技术学院机电工程与自动化学院,广东佛山528225
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面向高速串行接口应用,设计了一款25 Gibit/s的大摆幅电压模逻辑发送器.输出驱动器由3个相同的子驱动器并联而成,且每个子驱动器都包含依据二进制权重递增的5个驱动单元,从而实现32种不同的去加重控制.为了得到优化的均衡方案,且消除码间串扰的影响,提出了一种基于脉冲响应的后均衡分析策略.同时采用自偏置稳压器稳定电源电压,以提高发送器的信号完整性.发送器基于TSMC 40 nm工艺仿真,版图面积为132p.m×53pm.后仿真结果表明,发送器工作在25 Gibit/s时,差分输出眼图高达1.2 V,抖动为2.55 ps,功耗为16.2 mW.
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