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针对串行循环冗余校验（CRC）算法不适于高速传输且不易于硬件实现的问题，结合USB3．0设备中CRC的特点，推导出一种并行CRC算法，并用Verilog硬件编程语言加以实现．仿真试验表明，并行CRC校验算法具有更高的数据吞吐率，能降低时钟频率，易于硬件实现．
USB3．0设备中并行循环冗余校验的研究与实现
【摘 要】
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针对串行循环冗余校验（CRC）算法不适于高速传输且不易于硬件实现的问题，结合USB3．0设备中CRC的特点，推导出一种并行CRC算法，并用Verilog硬件编程语言加以实现．仿真试验表明，并行CRC校
【机 构】
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中国海洋大学信息科学与工程学院,昆明理工大学信息工程与自动化学院
【出 处】
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郑州轻工业学院学报(自然科学版)
【发表日期】
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2012年6期
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