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基于100Gbps光传输网络的RS(255,239)译码器设计
基于100Gbps光传输网络的RS(255,239)译码器设计
来源 :中国集成电路 | 被引量 : 0次 | 上传用户:vh600
【摘 要】
:
本文就基于100Gbps光传输网络的RS(255,239)译码问题,给出了一种并行译码的电路实现设计方案。该设计方案在充分考虑100Gbps光传输网络中的高速时钟需求的同时,也尽量考虑了将硬件逻辑资源的消耗降低。文中最后给出了仿真及FPGA综合结果。
【作 者】
:
饶清文
胡烽
朱齐雄
【机 构】
:
烽火通信科技股份有限公司
【出 处】
:
中国集成电路
【发表日期】
:
2015年11期
【关键词】
:
100Gbps光传输网络
RS(2
5
5
2
39)
并行译码
高速时钟
100Gbps OTN RS ( 255
239 ) parallel deco
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本文就基于100Gbps光传输网络的RS(255,239)译码问题,给出了一种并行译码的电路实现设计方案。该设计方案在充分考虑100Gbps光传输网络中的高速时钟需求的同时,也尽量考虑了将硬件逻辑资源的消耗降低。文中最后给出了仿真及FPGA综合结果。
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