【摘 要】
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分析了电流舵DAC中传统差分开关的缺点,采用了一种优化的四相开关结构。采用MOS电流模逻辑进行开关编码信号的限幅,以削弱电荷馈通效应。在此基础上,采用时钟交叉点配置电路,
【机 构】
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江苏信息职业技术学院电子信息工程学院;
【基金项目】
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江苏省教育厅资助项目(PPZY2015B190);江苏省教育厅“青蓝工程”科技创新团队资助项目
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分析了电流舵DAC中传统差分开关的缺点,采用了一种优化的四相开关结构。采用MOS电流模逻辑进行开关编码信号的限幅,以削弱电荷馈通效应。在此基础上,采用时钟交叉点配置电路,实现对DAC开关交叉点的精确控制。基于动态元件匹配译码技术,实现对电流源单元的随机调用。对该16位DAC进行了仿真和整体版图设计,其核心部分的芯片面积仅为2.2 mm~2。采用0.18μm CMOS工艺,对该DAC的性能参数进行了测试。测试结果表明,在1 GHz采样率和100 MHz输入信号频率的条件下,该DAC的无杂散动态范围约为67 dB,3阶互调失真IMD3约为76 dB,整体动态性能较好。
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