FPGA上浮点加/减法器的设计

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  摘 要 浮点加减运算是现代数字信号处理应用中非常频繁的操作,介绍了字长为20位的TI DSP浮点数在VirtexTM—E系列FPCA上的实现,这种设计在用三拍实现浮点加减运算时,速度达到了80M以上。
  关键词 浮点加法器 FPCA 移位 前导0/1判定
  文章编号1002—8331—(2003)02—0024—02 文献标识码A 中图分类号TN911
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摘 要 文章根据网络技术的发展需要,从计费系统的目标出发,设计了网络计费系统的三层结构,并论述了系统中各个模块的设计和实现方法,给出了一个综合计费系统的整体解决方案。  关键词 网络计费 认证 授权 HA  文章编号1002-8331—(2003)02—0004-03 文献标识码A 中图分类号TP393
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摘要 文章W—CDMA系统OVSF码的特性,针对随机动态分配算法存在码阻塞的问题,提出了动态有序分配算法,并对该算法的流程给予了详细的描述。文章最后通过对系统性能的仿真,证明该算法在系统负荷有余量的条件下保证了用户呼叫的公平性。  关键词 呼叫公平性 正交可变长扩频码 码阻塞 动态有序分配  文章编号1002—8331—(2003)02—0012—03 文献标识码A 中图分类号TN91
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