【摘 要】
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主要研究基于VHDL的可编程逻辑器件虚拟实验平台的设计和实现方案。平台的主体是VHDL程序翻译模块和模拟调度模块。翻译模块的核心是VHDL编译器,它将用户编写的VHDL源程序翻
【机 构】
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华中科技大学计算机科学与技术学院,华中科技大学网络与计算中心
【基金项目】
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国家科技支撑计划重点项目（2008BAH29B05,2008BAH29B06）, 湖北省省级教改项目（2009052）
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主要研究基于VHDL的可编程逻辑器件虚拟实验平台的设计和实现方案。平台的主体是VHDL程序翻译模块和模拟调度模块。翻译模块的核心是VHDL编译器,它将用户编写的VHDL源程序翻译转换为等价的C＋＋语言描述,最终生成若干C＋＋程序文件;模拟调度模块通过改进传统的事件驱动模拟算法,对翻译模块得到的C＋＋文件进行编译、连接和动态调度,实现对所描述的静态电路的动态行为的模拟。通过典型实验样例对平台进行了验证,结果表明该系统中进行实验的过程和结果与真实实验一致,达到预定设计要求。
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