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从描述方法、设计规则、时序等方面分析了用硬件描述语言VHDL在EDA设计中容易出现问题的原因，并提出了相应的解决方案。
数字系统设计中VHDL语言设计问题探讨
【摘 要】
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从描述方法、设计规则、时序等方面分析了用硬件描述语言VHDL在EDA设计中容易出现问题的原因，并提出了相应的解决方案。
【机 构】
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湖南怀化学院物电系电子信息教研室418008
【出 处】
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微型机与应用
【发表日期】
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2004年7期
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