【摘 要】
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针对嵌入式系统集成度高、专用性强的特点，设计一种基于AHB总线的嵌入式中断控制器。采用AHB总线接口，增强中断控制器的通用性和可移植性，ARM处理器通过AHB总线访问中断寄存器，实
【机 构】
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湖南大学物理与微电子科学学院,深圳市晶沛电子有限公司
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针对嵌入式系统集成度高、专用性强的特点，设计一种基于AHB总线的嵌入式中断控制器。采用AHB总线接口，增强中断控制器的通用性和可移植性，ARM处理器通过AHB总线访问中断寄存器，实现中断检测、响应、处理以及优先级的配置。该设计采用verilog-HDL语言编写，利用SMIC的0．18μm CMOS工艺进行逻辑电路综合和布局布线。测试结果表明，在正常工作条件下，该中断控制器的功耗为5．36mW，在50MHz时钟下完成一次中断操作最多需要0．7μs，可满足实时性和低功耗的要求。
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