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连线时延是新一代集成电路设计的重要课题之一。本文提出一种新的连线时延近似估算法，这种方法基于线网的ＲＣ树结构，采用Ｅｌｍｏｒｅ时延原理，给出了线网在未布线情况下时延的下界估计。它计算简单，精确度好，对时延驱动的版图优化设计具有重要的理论意义和实用价值。
集成电路的连线时延及其在版图设计中的估算
【摘 要】
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连线时延是新一代集成电路设计的重要课题之一。本文提出一种新的连线时延近似估算法，这种方法基于线网的ＲＣ树结构，采用Ｅｌｍｏｒｅ时延原理，给出了线网在未布线情况下时延的下界估计。它计算
【机 构】
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复旦大学电子工程系
【出 处】
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半导体学报
【发表日期】
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1997年7期
【基金项目】
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“九、五”国家重点科研项目
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