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基于高速串行BCD码除法的数字频率计的设计
基于高速串行BCD码除法的数字频率计的设计
来源 :电子技术应用 | 被引量 : 0次 | 上传用户:troy0215
【摘 要】
:
介绍了在FPGA芯片上实现数字频率计的原理。对各种硬件除法进行了比较,提出了高速串行BCD码除法的硬件算法,并将其应用在频率计设计中。
【作 者】
:
徐辉
王祖强
王照君
【机 构】
:
山东大学信息科学与工程学院250100
【出 处】
:
电子技术应用
【发表日期】
:
2004年8期
【关键词】
:
数字频率计
周期测量
FPGA
VHDL
状态机
串行BCD码除法
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介绍了在FPGA芯片上实现数字频率计的原理。对各种硬件除法进行了比较,提出了高速串行BCD码除法的硬件算法,并将其应用在频率计设计中。
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