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期刊论文
基于Verilog HDL语言的FPGA设计
基于Verilog HDL语言的FPGA设计
来源 :微计算机信息 | 被引量 : 0次 | 上传用户:guanshui6
【摘 要】
:
采用VerilogHDL语言在Altera公司的FPGA芯片上实现了RISC_CPU的关键部件状态控制器的设计,以及在与其它各种数字逻辑设计方法的比较下,显示出使用VerilogHDL语言的优越性.
【作 者】
:
彭保
范婷婷
马建国
【机 构】
:
621002,150090
【出 处】
:
微计算机信息
【发表日期】
:
2004年10期
【关键词】
:
VERILOG
HDL
FPGA
EDA
Verilog HDL
FPGA
EDA
【基金项目】
:
国家高技术研究发展计划(863计划),国家自然科学基金
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采用VerilogHDL语言在Altera公司的FPGA芯片上实现了RISC_CPU的关键部件状态控制器的设计,以及在与其它各种数字逻辑设计方法的比较下,显示出使用VerilogHDL语言的优越性.
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