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介绍采样率为500兆/秒、采样精度为8bit的高速A/D系统的设计结构以及高速电路设计中的问题,最后还讨论了如何在Windows95下设计具有实时性要求的程序。
500兆／秒高速A／D系统的实现
【摘 要】
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介绍采样率为500兆/秒、采样精度为8bit的高速A/D系统的设计结构以及高速电路设计中的问题,最后还讨论了如何在Windows95下设计具有实时性要求的程序。
【机 构】
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合肥中国科学技术大学近代物理系快电子实验室
【出 处】
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电子技术应用
【发表日期】
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2001年3期
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