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随着手持设备的兴起和芯片对晶片测试越来越高的要求,内建自测试的功耗问题引起了越来越多人的关注.本文对目前内建自测试的可测性设计技术进行了分析并对低功耗的VLSI可测性设计技术的可行性和不足分别进行了探讨.在文章的最后简单介绍了笔者最近提出的一种低功耗BIST结构.
面向低功耗BIST的VLSI可测性设计技术
【摘 要】
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随着手持设备的兴起和芯片对晶片测试越来越高的要求,内建自测试的功耗问题引起了越来越多人的关注.本文对目前内建自测试的可测性设计技术进行了分析并对低功耗的VLSI可测性
【机 构】
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东南大学国家专用集成电路系统工程技术研究中心
【出 处】
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电子器件
【发表日期】
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2002年1期
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