【摘 要】
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介绍了在MAXPLUS Ⅱ环境下,由已知输入的基准频率通过VHDL语言的设计得到输出频率符合要求的时钟信号的方法.用传统的方法设计,其设计过程和电路都比较复杂,其设计成果的可修
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介绍了在MAXPLUS Ⅱ环境下,由已知输入的基准频率通过VHDL语言的设计得到输出频率符合要求的时钟信号的方法.用传统的方法设计,其设计过程和电路都比较复杂,其设计成果的可修改性和可移植性都较差.所介绍的同步时钟产生过程简单方便,输出频率的大小可以根据需要,对程序作简单修改即可得到.设计的程序和方法将在文中详细说明.
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