【摘 要】
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在RSA加密算法的硬件设计中,大素数的生成极为关键。为了提高RSA算法中大素数的生成效率,在传统筛法的基础上,提出了一种能自动生成确定性大素数的硬件实现算法-循环迭代法。
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在RSA加密算法的硬件设计中,大素数的生成极为关键。为了提高RSA算法中大素数的生成效率,在传统筛法的基础上,提出了一种能自动生成确定性大素数的硬件实现算法-循环迭代法。该算法的硬件实现采用状态机架构,使用VerilogHDL语言描述,并通过Modelsim仿真。实验结果表明,使用该方法生成素数序列,具有快速准确、高效、易于硬件实现的特点,为RSA算法的使用提供了极大的便利。
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