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基于FPGA的正码速调整的设计与实现
基于FPGA的正码速调整的设计与实现
来源 :微计算机信息 | 被引量 : 0次 | 上传用户:chnlaozhang
【摘 要】
:
本文提出了基于FPGA正码速调整的设计方案,采用格雷码对地址编码的异步FIFO设计,并利用MAXPLUSII进行编译和仿真。结果表明,设计方法切实可行。
【作 者】
:
李月岗
梅进杰
【机 构】
:
空军雷达学院,空军95927部队
【出 处】
:
微计算机信息
【发表日期】
:
2009年20期
【关键词】
:
正码速调整
FPGA
格雷码
异步FIFO
Positive justification
FPGA
Gray code
Asynchronous FI F
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本文提出了基于FPGA正码速调整的设计方案,采用格雷码对地址编码的异步FIFO设计,并利用MAXPLUSII进行编译和仿真。结果表明,设计方法切实可行。
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