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文章讨论主ＰＣＩ（ＰＣＩ－Ｍａｓｔｅｒ）接口电路的ＶＬＳＩ设计方法，文章从总体设计思路，接口内侧（用户侧）通讯协议的制定和状态机等各个角度对主ＰＣＩ接口的设计方法作了较为全面的介绍，并以三级缓存的为例介绍了一个完整的底层ＶｅｒｉｌｏｇＨＤＬ设计。
具有三级缓存的PCI Master总线接口的VLSI设计
【摘 要】
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文章讨论主ＰＣＩ（ＰＣＩ－Ｍａｓｔｅｒ）接口电路的ＶＬＳＩ设计方法，文章从总体设计思路，接口内侧（用户侧）通讯协议的制定和状态机等各个角度对主ＰＣＩ接口的设计方法作了较为全面的介绍，并以三级缓存的为例介绍了一个完整
【出 处】
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微电子学与计算机
【发表日期】
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1999年B11期
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