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本文探讨鉴频鉴相器（PFD）设计中死区的产生原因和消除方法。设计了一种用于高速锁相环的零死区PFD。这种PFD采用无反馈回路结构。在保证死区为零的前提下，兼顾功耗和速度性能。尤其适用于基于锁相环的高速时钟和数据恢复电路（CDR）、高速频率合成器等对速度和抖动性能有很高要求的电路。
一种用于高速锁相环的零死区鉴频鉴相器
【摘 要】
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本文探讨鉴频鉴相器（PFD）设计中死区的产生原因和消除方法。设计了一种用于高速锁相环的零死区PFD。这种PFD采用无反馈回路结构。在保证死区为零的前提下，兼顾功耗和速度性能。
【机 构】
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清华大学电子工程系微波与数字通信国家重点试验室
【出 处】
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微计算机信息
【发表日期】
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2006年12Z期
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