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级连码是一种有效而复杂的信道编码方法.设计了一种可以在两种不同码率工作的低码率级连码编解码电路,根据系统指标要求对其中的核心计算单元Viterbi解码器,RS解码器进行了结构和电路优化设计.同时,提出了一种交织器-缓冲器管理方法,以减少数据传输时的复杂性与存储单元的数量.
一个低码率级连码系统的设计与FPGA实现
【摘 要】
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级连码是一种有效而复杂的信道编码方法.设计了一种可以在两种不同码率工作的低码率级连码编解码电路,根据系统指标要求对其中的核心计算单元Viterbi解码器,RS解码器进行了结
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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微电子学
【发表日期】
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2001年3期
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