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针对传统方式开发的自适应滤波器效率低、难度大的缺点,利用DSP Builder,设计出了基于延时最小均方（DLMS）算法的16阶系统辨识自适应滤波器。仿真与测试表明了设计的正确性,并在CycloneⅡ系列FPGA芯片上完成了硬件验证,滤波器最高频率达到82.07 MHz,数据吞吐量显著提高。
基于DSP开发工具的自适应滤波器
【摘 要】
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针对传统方式开发的自适应滤波器效率低、难度大的缺点,利用DSP Builder,设计出了基于延时最小均方（DLMS）算法的16阶系统辨识自适应滤波器。仿真与测试表明了设计的正确性,并在
【机 构】
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空军工程大学导弹学院
【出 处】
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探测与控制学报
【发表日期】
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2010年3期
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