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集成电路设计工艺达到深亚微米领域时,互连线的延迟影响越来越大,已经超过门延迟,成为电路延迟的主要部分.因此,设计前期的互连线延迟的评估已成为集成电路设计中必须解决的问题.目前,已经提出了许多互连延迟的评估分析方法.本文主要介绍采用概率解释算法的原理及具体实现,并比较各自的优缺点.
互连线延迟评估的概率解释算法
【摘 要】
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集成电路设计工艺达到深亚微米领域时,互连线的延迟影响越来越大,已经超过门延迟,成为电路延迟的主要部分.因此,设计前期的互连线延迟的评估已成为集成电路设计中必须解决的
【机 构】
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西安电子科技大学机电工程学院,北京中电华大电子设计有限责任公司,北京NEC集成电路设计有限责任公司
【出 处】
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计算机辅助工程
【发表日期】
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2004年1期
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