【摘 要】
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针对网络入侵检测系统（NIDS）中复杂正则表达式匹配的数量限定符进行了硬件设计和实现。经过对这3种限定符匹配原理的分析，改变了以往的直接复制多个重复单元的实现方法，设计了一
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针对网络入侵检测系统（NIDS）中复杂正则表达式匹配的数量限定符进行了硬件设计和实现。经过对这3种限定符匹配原理的分析，改变了以往的直接复制多个重复单元的实现方法，设计了一套完整的优化的数量限定符FPGA实现电路。实验测试结果表明，本设计每个非元字符平均大约需要0．92个逻辑单元，系统可以达到1．2Gb／s的吞吐能力。
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