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VLSI集成电路芯片测试技术正在向高层次测试推进.针对Verilog硬件描述语言,提出了一种在寄存器传输级(register transfer level,RTL)上的电路模型VRM. 该模型着重于实际应用,可输出文本格式文件,便于开发实用的RTL级故障模拟和RTL级测试生成等软件.基于该模型,还实现了一个简单的RTL逻辑模拟程序以验证VRM模型的可行性.