【摘 要】
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在信号调制过程中,为了缩短载波生成的捷变时间,分析了影响捷变时间的因素.提出了单频信号的并行合成结构,解决了载波频率受现场可编程逻辑门阵列（FPGA）时钟限制的问题.为了解
【机 构】
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武汉大学电子信息学院,武汉大学电气工程学院
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在信号调制过程中,为了缩短载波生成的捷变时间,分析了影响捷变时间的因素.提出了单频信号的并行合成结构,解决了载波频率受现场可编程逻辑门阵列（FPGA）时钟限制的问题.为了解决调制过程中采样频率受时钟约束的问题,给出了矢量信号的正交并行调制结构.通过在FPGA上编写Verilog代码实现了时钟频率为160MHz、采样率为1.92Gsample/s的并行矢量信号调制,载波频率为200-300MHz可变,捷变时间小于35ns.结果表明,并行载波生成和并行调制的方法在克服系统时钟约束方面有较强的实用性.
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