【摘 要】
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通过对锁相环（PLL）与直接数字频率合成器（DDS）的工作原理分析,得出PLL相位噪声数学模型与减小DDS杂散的方法。介绍了一种S波段的宽带小步进频率合成器的设计与实现,并通过了实物
【机 构】
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中国电子科技集团公司第五十四研究所
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通过对锁相环（PLL）与直接数字频率合成器（DDS）的工作原理分析,得出PLL相位噪声数学模型与减小DDS杂散的方法。介绍了一种S波段的宽带小步进频率合成器的设计与实现,并通过了实物制作与测试。测试在输出频率范围为1 800~2 350 MHz、频率步进为10 k Hz时,相位噪声为-88 d Bc/Hz@10 k Hz,杂散低于-60 d Bc。测试结果证明,该频率合成器的性能达到了设计指标要求。
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