【摘 要】
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在对TDMP算法优化的基础上,提出了一种LDPC译码器VLSI架构和实现方法.与目前已经存在的LDPC译码器相比,这种实现方法的优势主要有：1）能够实现快速收敛,将译码迭代次数降低为经
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
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在对TDMP算法优化的基础上,提出了一种LDPC译码器VLSI架构和实现方法.与目前已经存在的LDPC译码器相比,这种实现方法的优势主要有：1）能够实现快速收敛,将译码迭代次数降低为经典方法的50%以下,进而降低功耗;2）用于存储中间置信信息的存储器使用量比传统方法减少50%以上,大大减少芯片面积;3）校验节点置信度更新采用归一化Min-Sum算法（NMS）,降低计算复杂度,选取的校正因子保证了译码器的BER性能;4）充分利用校验矩阵的准循环特点,实现规整的芯片内部互连线,减小布线难度.用这种架构实现了符
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