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TD-SCDMA系统中维特比译码器的硬件实现
TD-SCDMA系统中维特比译码器的硬件实现
来源 :重庆邮电学院学报(自然科学版) | 被引量 : 5次 | 上传用户:shaohuang321
【摘 要】
:
TD-SCDMA系统中采用约束长度为9的卷积编码作为信道编码方案之一,维特比译码器是一种人们广泛采用的卷积编码的解码器;通过分析卷积编码及维特比译码的过程,介绍了一种适合TD-SCDMA系统中软判决维特比译码器实现的硬件结构,此结构也适用于WCDMA等无线通信系统的维特比译码器的设计。
【作 者】
:
钟文枫
郑建宏
【机 构】
:
重庆邮电学院移动通信工程研究中心
【出 处】
:
重庆邮电学院学报(自然科学版)
【发表日期】
:
2005年04期
【关键词】
:
TD—SCDMA
信道编码
维特比译码器
FPGA
ASIC
TD-SCDMA channel-coding Viterbi decoderFPGA ASIC
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TD-SCDMA系统中采用约束长度为9的卷积编码作为信道编码方案之一,维特比译码器是一种人们广泛采用的卷积编码的解码器;通过分析卷积编码及维特比译码的过程,介绍了一种适合TD-SCDMA系统中软判决维特比译码器实现的硬件结构,此结构也适用于WCDMA等无线通信系统的维特比译码器的设计。
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