基于ALTERA FPGA的低延迟QDR2 RAM控制器解决方案

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QDR2 RAM是一种特殊结构的SRAM,它的读写端口是分开的,有两套读写数据总线。地址是读写共享的.对BURST长度为2的QDR2 RAM来说,渎地址在时钟CK的上跳沿锁存,写地址在时钟CK的下跳沿锁存。
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