基于FPGA与CPCI总线的通用时统模块设计

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通过分析传统时统模块的工作原理以及用户对时统模块需求的不同,提出了一种基于现场可编程门阵列(FPGA)来实现通用时统模块的设计方法,该方法基于一片FPGA芯片,其内部实现了同步脉冲的提取、对时功能、自守时、脉宽调制等功能,与以往的各种方法相比,具有可重配置、可扩展性、灵活性、通用性、功耗低的优点,同时提高了同步精度,具有较强的抗干扰性。解决了传统时统模块定时精度不高、设置固定只能满足单一需求等问题。
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