基于FPGA的二维提升小波变换IP核设计

来源 :微计算机信息 | 被引量 : 3次 | 上传用户：liongliong476

【摘要】

：

提出了一种高效并行的二维离散提升小波(DWT)变换结构,该结构只需要7行数据缓存,即可实现行和列方向同时进行滤波变换。采用一种基于CSD编码和优化的移位加操作实现常系数乘法器,整个小波变换插入多级流水线寄存器,加快了处理速度。用VHDL设计可自动验证的testbench,通过matlab+modelsim联合仿真能方便有效地对IP核进行验证。此IP核具有3个可配置参数,分别为图像尺寸、位宽、小波变

【作者】

：

欧龙张启衡杨洪许俊平

【机构】

：

中国科学院光电技术研究所国家863计划光束控制重点实验室,中国科学院研究生院

【出处】

：

微计算机信息

【发表日期】

：

2009年02期

【关键词】

：

二维离散小波换 CSD编码乘法器 IP核 2D-DWT CSD-based multiplier testbench IP Core

【基金项目】

：

基金项目：国家863计划资助项目（编号不公开）申请人：张启衡

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