【摘 要】
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低密度校验(Low-Density Parity-Check)码作为迄今为止性能接近香农限的前向纠错码(FEC)之一,在无线通信、卫星通信和无线网络技术等领域获得了广泛的应用。随着5G技术的发展
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低密度校验(Low-Density Parity-Check)码作为迄今为止性能接近香农限的前向纠错码(FEC)之一,在无线通信、卫星通信和无线网络技术等领域获得了广泛的应用。随着5G技术的发展,通信系统对传输速率的需求逐渐增加,更高的传输速率对LDPC译码器的吞吐量提出了更高的要求。本文给出了一种全并行LDPC译码器设计,并采用理论分析和仿真结果分析相结合的方法,对LDPC码的并行译码方法进行了研究,给出了全并行译码器的FPGA实现方法。
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