WBAN中△-∑调制器的设计及纳米级实现

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基于15bit字长累加器和预设LSB噪声抑制技术,在90nmCMOS工艺下对MASH结构△-∑调制器进行了优化设计和实现。实验结果表明,优化后的△-∑调制器能够在噪声抑制性能、器件尺寸及功耗上达到最优化的平衡,器件尺寸仅为40.5μm×45μm,功耗仅为34μW,满足无线人体局域网器件微型化和超低功耗的严格要求。作为阶段性研究,实验结果为下一步无线收发器的设计提供了重要的理论及设计参考。
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