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<正> 1.原理图常见错误: (1)ERC报告管脚没有接入信号: a.创建封装时给管脚定义了I/O属性; b.创建元件或放置元件时修改了不一致的grid属性,管脚与线没有连上;
用protel设计电路板常见错误分析
【摘 要】
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<正> 1.原理图常见错误: (1)ERC报告管脚没有接入信号: a.创建封装时给管脚定义了I/O属性; b.创建元件或放置元件时修改了不一致的grid属性,管脚与线没有连上;
【出 处】
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电子制作
【发表日期】
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2003年12期
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