【摘 要】
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为解决串口输入数据率与FPGA处理模块处理数据率不匹配的问题,本研究利用双FIFO作为数据缓存模块,采用乒乓操作控制数据流,通过对双FIFO交替进行输入和输出控制,实现了数据在高速串口模块和低速处理模块间的无缝传输。测试结果表明,在串口输入数据率为38.4KHz和处理模块处理数据率15KHz条件下,实现了数据的连续无缝传输,确保了数据传输的正确性。
【机 构】
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沈阳理工大学信息科学与工程学院 辽宁 110159
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为解决串口输入数据率与FPGA处理模块处理数据率不匹配的问题,本研究利用双FIFO作为数据缓存模块,采用乒乓操作控制数据流,通过对双FIFO交替进行输入和输出控制,实现了数据在高速串口模块和低速处理模块间的无缝传输。测试结果表明,在串口输入数据率为38.4KHz和处理模块处理数据率15KHz条件下,实现了数据的连续无缝传输,确保了数据传输的正确性。
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