基于Retimer的25Gbps高速信号链路设计

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随着通信技术不断发展,数据量的计算处理对数据带宽提出了更高的要求.100G以太网迅猛发展,尤其IEEE802.3bj规范中100GBASE-KR4(25Gbps*4)应用广泛.25Gbps高速信号链路的信号完整性设计面临更大的挑战,跨背板的PCB走线直接互联已经难以满足规范要求.本文通过将Retimer(DS280DF810)应用于高速链路中,可以解决远距离高速信号链路的信号完整性问题.
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