【摘 要】
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伴随着集成电路领域的飞速发展,利用验证技术在流片前,尽可能的覆盖功能点找出bug,也成为了芯片设计过程中最重要的环节。在System Verilog基础上开发的UVM(universal verifi
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伴随着集成电路领域的飞速发展,利用验证技术在流片前,尽可能的覆盖功能点找出bug,也成为了芯片设计过程中最重要的环节。在System Verilog基础上开发的UVM(universal verification methodology)作为最新一代的验证技术,结合了OVM、VMM、ERM等验证技术的优势,大幅提高覆盖率驱动验证的便捷程度和效率。本文主要以提高验证代码的复用性和效率为切入点,在现有的UVM验证方法学基础上,提出了在UVM平台中复用C测试用例方法、能提升验证效率的随机约束设计,并将这两个方法应用到了对SATA控制IP的验证,验证的过程和结果展示了,这两种方法对现在UVM框架的性能提高,并提高重用代码量,提升验证效率。
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