【摘 要】
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随着工艺技术的进步,单颗芯片上集成的晶体管的数量已经超过十亿.为了对大规模芯片设计进行验证,搭载多颗千万门级FPGA的验证平台已经成为一种必然趋势.然而,在逻辑资源急速
【基金项目】
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受国家核高基课题（项目号2015ZX01028-101）、国家自然科学基金（项目号61472435）支持资助.
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随着工艺技术的进步,单颗芯片上集成的晶体管的数量已经超过十亿.为了对大规模芯片设计进行验证,搭载多颗千万门级FPGA的验证平台已经成为一种必然趋势.然而,在逻辑资源急速增加的情况下,FPGA的I/O端口数量却没有相应增加,使得I/O端口数量成为多FPGA原型验证系统的瓶颈.为了解决这个问题,时分复用技术（TDM：Time-Division-multiplexing）被广泛采纳.基于XilinxVirtex-7XC7V2000TFLG1925FPGA,本文在2颗以及4颗FPGA互连平台上实现了多FPGA时分
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