【摘 要】
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D型触发器在数字电路中应用广泛,其逻辑图示于图1。从图中可以看出,数据从 D端是经过几个门的延迟,串行进行到输出端Q和Q的。这种触发器要计数工作到100兆赫以上,从D到Q和Q
【机 构】
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中国科学院半导体所二室,长沙工学院计算机所三室
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D型触发器在数字电路中应用广泛,其逻辑图示于图1。从图中可以看出,数据从 D端是经过几个门的延迟,串行进行到输出端Q和Q的。这种触发器要计数工作到100兆赫以上,从D到Q和Q的延迟必须小于10
D-type flip-flop in the digital circuit widely used, the logic diagram shown in Figure 1. It can be seen from the figure, the data from the D terminal is the delay after a few doors, the serial to the output Q and Q. This flip-flop to count work to more than 100 MHz, the delay from D to Q and Q must be less than 10
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