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针对SDRAM时序控制复杂等设计难点,提出了一种基于现场可编程门阵列（FPGA）设计SDRAM控制器的方法.使用状态机的设计思想,采用Verilog硬件描述语言对时序控制程序进行了设计.通过Modelsim SE 6.0开发平台进行了时序仿真,得到的SDRAM读写仿真波形图时序合理、逻辑正确.
数据采集系统中SDRAM控制器的FPGA设计
【摘 要】
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针对SDRAM时序控制复杂等设计难点,提出了一种基于现场可编程门阵列（FPGA）设计SDRAM控制器的方法.使用状态机的设计思想,采用Verilog硬件描述语言对时序控制程序进行了设计.通
【机 构】
：
渭南师范学院数理学院
【出 处】
：
电子设计工程
【发表日期】
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2017年15期
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