【摘 要】
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行波信号的有效提取是配电网接地故障分析的前提,针对配电线路接地故障,行波信号具有带宽高、背景噪声强的特点,设计以FPGA为主控芯片的行波采样及降噪处理系统。针对行波电
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行波信号的有效提取是配电网接地故障分析的前提,针对配电线路接地故障,行波信号具有带宽高、背景噪声强的特点,设计以FPGA为主控芯片的行波采样及降噪处理系统。针对行波电压幅值变化大的特点提出双路采集行波方案,采用Verilog HDL编程实现FPGA对AD7626的采样时序控制,并通过FIR数字滤波器对行波信号进行降噪处理,采样数据最终存入RAM中供DSP读取进行定位运算。经过对各模块进行仿真和实际测试,表明该采集系统工作稳定,数据采集准确,降噪后效果理想,具有工程应用价值。
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