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期刊论文
基于FPGA的任意相位时钟管理器的设计
基于FPGA的任意相位时钟管理器的设计
来源 :电讯技术 | 被引量 : 0次 | 上传用户:fairboy2000
【摘 要】
:
在通信双方为同源时钟的前提下,为保证时钟在接口处把所有数据都正确采样进来,利用Ahera的综合开发平台QuartusⅡ,实现了采样时钟相位根据输入数据相位自动调整,使采样时钟能找到
【作 者】
:
杨永强
李斌
李军杰
薛宁
齐浩博
张鹤
【机 构】
:
沈阳理工大学信息科学与工程学院
【出 处】
:
电讯技术
【发表日期】
:
2008年4期
【关键词】
:
数字电路设计
时钟系统
相位调整
时钟同步
digital circuit design
clock system
phase adjustment
c
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在通信双方为同源时钟的前提下,为保证时钟在接口处把所有数据都正确采样进来,利用Ahera的综合开发平台QuartusⅡ,实现了采样时钟相位根据输入数据相位自动调整,使采样时钟能找到最佳的采样时间来采样外来数据。任意相位时钟管理器可以产生高精度动态相位的时钟信号。
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