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VHDL支持多层次的混和描述,在实际的设计过程中,对于不同层次上的设计需求也是不一样的.将VHDL语言应用于数字电路教学过程中,针对不同的逻辑单元,采用不同的建模方式,可以培养学生的分析问题、解决问题的综合应用能力,使学生尽可能地掌握和使用VHDL这一现代化的设计工具和设计理念.
VHDL语言中建模方式及其在数字电路教学中的应用
【摘 要】
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VHDL支持多层次的混和描述,在实际的设计过程中,对于不同层次上的设计需求也是不一样的.将VHDL语言应用于数字电路教学过程中,针对不同的逻辑单元,采用不同的建模方式,可以培
【机 构】
：
福建省直属机关业余大学
【出 处】
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山西电子技术
【发表日期】
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2005年1期
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