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VHDL语言中建模方式及其在数字电路教学中的应用
VHDL语言中建模方式及其在数字电路教学中的应用
来源 :山西电子技术 | 被引量 : 0次 | 上传用户:ahehehehehe
【摘 要】
:
VHDL支持多层次的混和描述,在实际的设计过程中,对于不同层次上的设计需求也是不一样的.将VHDL语言应用于数字电路教学过程中,针对不同的逻辑单元,采用不同的建模方式,可以培
【作 者】
:
时青
【机 构】
:
福建省直属机关业余大学
【出 处】
:
山西电子技术
【发表日期】
:
2005年1期
【关键词】
:
硬件描述语言
行为描述
RTL描述
结构描述
VHDL语言
建模方式
数字电路教学
hardware description language
behavior
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VHDL支持多层次的混和描述,在实际的设计过程中,对于不同层次上的设计需求也是不一样的.将VHDL语言应用于数字电路教学过程中,针对不同的逻辑单元,采用不同的建模方式,可以培养学生的分析问题、解决问题的综合应用能力,使学生尽可能地掌握和使用VHDL这一现代化的设计工具和设计理念.
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