【摘 要】
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在科技发展迅速的社会,电子产品越来越多,数字信号的优势在计算机,无线通讯,医疗等领域体现越来越明显,高速的数字时钟设计的研究与需求也越来越高,一般在100M以上。在数字时
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在科技发展迅速的社会,电子产品越来越多,数字信号的优势在计算机,无线通讯,医疗等领域体现越来越明显,高速的数字时钟设计的研究与需求也越来越高,一般在100M以上。在数字时钟的设计中一般有两种思路,一种是片外时钟,一种是片内时钟。片外时钟的设计思路简单,直接在外部数字电路的计算下形成一个50%占空比的时钟,再在内部经过DLL或者PLL电路形成交叠时钟 ,或者通过RS触发器的原理形成非交叠时钟,一般非交叠部分占总周期的±1/50。但是片外时钟的缺点也同样明显,它因为是单端输入,大大增大了共模信号不仅
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